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Allegro172版本线到铜皮不按照设定值避让的原因和解决办法

用Allegro做PCB设计的时候，有时会单独给某块铜皮附上线到铜皮额外再增加一个数值，如下图

在规则的基础上，额外再避让10mil

规则避让line到铜皮10.02mil

额外设置多避让10mil，避让的结果却是30.02mil，正确的是20.02mil