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各位看到这篇文章时#xff0c;24届校招招聘已经渐进尾声了。 在这里记录一下自己所有面试#xff08;除了时间过短或者没啥干货的一些研究所外#xff0c;如中电55所#xff08;南京#xff09;#xff0c;航天804所#xff08;上海#xff09;#xff09;的经… 引言
各位看到这篇文章时24届校招招聘已经渐进尾声了。 在这里记录一下自己所有面试除了时间过短或者没啥干货的一些研究所外如中电55所南京航天804所上海的经历以及感悟。希望给秋招的小伙伴或者明年、后年要找工作的小伙伴一些借鉴。
本人的话研究生期间所做的项目都是跟FPGA相关并未参与ASIC芯片设计相关的项目。
HR面试不记录在内只记录跟技术面沾边的一些问题。 联发科技
实习 一面 岗位IC设计验证 意向地点安徽合肥 面试时间2023 - 05 - 11 930 持续时间半小时 面试官2人男 面试流程 自我介绍面试官看简历根据简历写的项目让自己选择一个很熟悉的做的时间最长的项目描述一下。面试官要求打开白板画出整个项目的流程图。面试官问了DDR3读写的内容。面试官问项目中的时钟分配时钟是否同源等以及一些CDC。面试官问了有没有做过代码覆盖率。面试官问有没有用过IC的一些EDA软件。面试官询问可实习时长。最好长一些3个多月面试官简单介绍实习内容。我咨询实习问题。 经验教训 DDR3读写控制我上来就是说了用Xilinx 的7系列MIG IP核实现DDR3的读写控制器自己负责对DDR3读写仲裁的一些逻辑实现。但是感觉面试官觉得既然用IP核实现就没啥好问的感觉我没有做什么主要逻辑。当时我还强调了一下用的AXI接口控制DDR3读写以为面试官会问AXI协议但是也没问。项目介绍由于我的项目是做雷达信号处理但是他们可能不做雷达相关产品对这个也了解比较少。可能也不太感兴趣。还有就是实现的工程里面包含比较多的IP核比如CSI2的一些IPFFT IP、MIG IP等。他们感觉我的代码量不够还专门问我具体哪一部分是我自己编程实现的。感觉发哥这个对coding的要求还比较高。实习时间两个月左右应该有点短至少可能是3个月。他们希望实习时间可以长一些。 总结 这次面试我自己总体感觉不是很顺利也可能是准备不足。一些项目的细节点本来想说的但是有些遗忘。后面还是多复盘项目准备要更细一点更充分一些。不能只有个大概。特别是在特别能表现个人能力的地方。 后续这个实习的话可能我去得意愿也不大觉得比较麻烦。所以这个实习的事情后面也没有后话了。 提前批 一面 岗位数字IC工程师设计方向、验证方向、整合方向 意向地点安徽合肥 面试时间2023 - 08 - 14 1600 持续时间1小时 面试官2人男 面试流程 自我介绍。面试官问了我本科期间国家励志奖学金的获得门槛是否可以连续多年获得。简历里面写了熟练掌握IIC总线其实挖了一个小坑面试官问了几个问题第一个问题你这个 IIC 的模块是自己写的还是借鉴网络上的写法第二个问题问的 IIC 有几种传输速度彻底搞懂IIC总线5I2C总线传输速度第三个问题问的 IIC 最快的传输速度为3.4Mbps那么为什么不能更快。这个问题还没想到具体是为啥。第四个问题IIC的IO有什么特点基础通信协议之 IIC (I2C) 详细讲解 这里面提到一点IIC总线上所有器件的SDA、SCL引脚输出驱动都为 开漏(OD) 结构通过外接上拉电阻实现总线上所有节点SDA、SCL信号的线与逻辑关系。第五个问题如果现在有一个IIC或者UART的功能模块设计你的设计思路是什么会分为哪几个模块ASIC内部需要通过APB或者AHB总线向其他模块获取到将要发送的数据或者将接收到数据通过总线的形式传给需要的模块另外串行通信还需要一些串/并转换模块数据收发模块等。他主要想问的是ASIC或者FPGA内部模块之间通信的都会借助于一些总线访问比如AXI AHB APB 协议。这位面试官后面也给出了答案原话通常在芯片里面大部分都是用 AMBA BUS 做模块与模块之间的连接。接下来是另外一位面试官。主要是问了简历上具体的几个项目。给我的感觉面试官很想知道一个项目中一共有几个人负责你个人起到了什么作用做了什么事情是否有创新做的代码是前人就有的还是说自己写的还以就是代码量有多少。我知道很多研究生的FPGA项目为了尽可能短时间的完成项目任务都会使用一些IP CORE但是这在面试官看来可能不是一个好的点在他们看来大部分工作由IP CORE来完成那么你的工作量到底在哪里。真的建议规避这一点把自己写代码做的东西多说调用IP核的事情少说。面试官问我某次数学建模比赛获奖的相关问题。这里面可以发挥的点就比较多了如果你是参赛队伍的主要负责人或者主要代码实现人就可以说挺多的。简历上写了了解UVM面试官让我简单说一下我所了解的UVM是什么后面又问我为什么想着学UVM简历上写了了解DFT所以面试官顺带就问了一嘴DFT了解哪些相关的知识插入的寄存器链和设计里面的寄存器区别在哪里数字 IC 技能拓展29浅谈 DFT 与扫描链主要的区别就是扫描的寄存器链相比于普通的寄存器多了1个MUX。面试官说问一个Verilog相关的问题关于deburrs电路就是信号去毛刺的电路设计怎么做计时毛刺的宽度低于一定时间认为是毛刺否则就是有用信号。开始问求职意向地有无女朋友感觉自己最强的地方是什么自己的弱点在哪里。最后就是写一个 verilog 的握手小模块他们说主要就是看下代码功底。最后时间快结束他们说不用往后写了差不多了解了。最后就是问了一些联发科技公司的情况。 总结有些技术问题还是需要多抠一下需要更深入一点。还有就是项目的细节还需要仔细复盘。 后续次日HR就通知我一面通过约二面的时间。发哥的效率这波很高。 提前批 二面 岗位数字IC工程师设计方向、验证方向、整合方向 意向地点安徽合肥 面试时间2023 - 08 - 18 1700 持续时间40 min 面试官1人男 面试流程 自我介绍。我的简历上的项目都写的项目负责人面试官关于“项目负责人”的事情问了一些项目都是你一个人来做的的吗还是说有一个团队你是这个团队的主要负责人那我的回答肯定是第二个其实我建议简历上都写上项目负责人问起来也没关系就说是项目团队的主要负责人另外最好结合具体的项目细说一点体现出你项目负责人的功能让面试官相信你的能力。面试官问这几个项目都是从头开始的还是说继承之前的项目继续做。他可能比较关心的是这个项目里你自己真正能够参与的有多少。这里我建议大家实话实说但是要加一点凸显自己能力的修饰这很重要也别是一些继承师兄师姐的项目。面试官哪个项目你觉得收获最大或者说投入的时间精力最大这种问题就是到自己发挥的时候了展现自己实力多说一些项目里自己真正抠明白很熟练的东西多说。面试官问找工作的思路或者考量的点是什么这个点的话我觉得如果你是真心想以当前求职的IC行业作为后续的职业那你就大胆直接地说出你的想法如果你是跨专业就业那你也要自信地说出支持你跨专业的理由尽量让面试官觉得这人说的合理。至于说工作地点的话最好是包括你正在面试的这家公司的地点可以更宽一点范围但是不能不包括这家公司。面试官那你现在投了哪些公司我就列说了几个没有说很多。还对今年的就业行了稍微抱怨了一下就业真的很难。下面就是聊天问我上几届师兄都去哪了这个就实话说一些呗。没太大所谓。面试官IC前端设计 验证以及后端设计DFT你都是可以接受的我肯定了他的提问但是也表达了更想做设计的意愿。你觉得你研究生阶段最大的收获是什么这个是一个很宽泛的问题随便发挥可以说自己对以后职业道路认识更加清晰有了更明确的规划也可以说自己技术上的长进。研究生期间做的项目你觉得对你的挑战大吗你还是一个学生挑战和困难肯定有的挑自己觉得最好说的几个说一下当然也不要太否定自己吧不要让面试官觉得你做项目很吃力。工程节点加班这个你怎么看其实就是问你能不能接收在项目关键节点的时候加班。这个就不用教了哈哈哈你应该知道咋回答的。我觉得这个完全没问题的甚至我还举例说自己研究生期间到项目节点出差加班啥的。能够证明你可以应对困难能吃苦。你对我们这边有多少了解这个就是要求大家在二面之前要做的准备工作包括公司理念业务范围。主要技术分支等等。是否单身家里人对找工作的态度问题反问环节我问了发哥的新人培养流程以及部门划分。这里跟大家透露一点新员工入职有2个月的整体培训结束后结合个人意愿培训表现将每个人分配到不同部门的不同岗位之后再进行一些与本部门契合的一些专业培训。 整体感觉二面还是比较轻松的。也就这些记录了。 中电38所
提前批 技术面 岗位FPGA设计 意向地点安徽合肥 面试时间2023 - 06 - 30 900 持续时间半小时 面试官1人男 面试流程 小插曲我的简历上写了博客链接的东西但是奈何线下宣讲时交上去的是纸质简历面试官提前发邮件给我加了微信说想看下我写的博客后来我把电子版的简历发给他他应该是看了我的博客内容 刚开始他说了一些对写技术博客的看法对我的博客给了一些肯定并且说业内人坚持写博客记录的也不多除了CSDN他说还有GITHUB GITEE等平台可以直接上传工程便于工程管理。后面就步入正题由于他对我的整体印象和感觉很不错他就让我自己说两个在技术上很有成就感的事情。我就说了自己手写FIR滤波器以及CFAR检测器雷达上用的的过程。中间的交流还挺愉快的。后面他说提一个需求就是CFAR检测器有很多诸如保护单元个数、参考单元个数等关键参数那么想要做到适时调整测试有什么思路。我当时说了两个通过串口或者网口建立上位机与FPGA之间的通信然后将关键参数解析后直接送入CFAR检测器模块。他首先是认同了这种思路另外就是他提出用AXI-Lite协议AXI协议支持多主多从内部有自己的一套仲裁机制。开发起来更方便。并且XILINX 的IP核基本上都用的AXI接口。他问了我对HLS咋看我说不太了解基本都是直接写设计代码的。后面基本上就是介绍所内部门情况。面试官自己是数字中心部门的。然后也捎带说了加班情况、出差情况研究所都那样哈哈。自己斟酌。 总结 这次面试总体上来说还是比较的轻松愉悦。后面对AXI、以及HLS可能要再准备一些。 后续 HR面试在线下进行且与技术关系不大不做记录了。大约一周后收到了录用意向给到22W由于自身的考虑没有签。 航天804所 面试主要看项目是否对口个人能力想招一些进去就能直接干活的。 offer详情 任职岗位雷达信号处理设计岗部门21室。在征求本人意见的基础上 合同期单位将在入职后与你就双方权利义务签订劳动合同合同期为自入职之日起3年试用期为6个月。 薪资待遇 1.试用期工资不低于13500元/月。 2.转正后年收入年度考核称职基础生不低手31万元/年薪酬与绩效考核挂钩。 中电55所 技术面HR面。技术面问的比较浅就问一些项目和FPGA的内容。 offer详情 一、工作岗位FPGA逻辑设计工程师 二、工作地点江苏省南京市 三、薪酬福利 一编制给予事业编制。 二薪酬第一年税前年薪总包26-33万元人民币具体根据岗位价值、个人绩效取酬。 三福利 1.除五险一金外缴纳职业年金 2.提供职工食堂、单身公寓、通勤班车、健康体检、补充医疗保险、户籍办理等多方面保障 3.除国家法定节假日外提供带薪年休假、春节长假、探亲假等假期。 凌久微电子
技术面 岗位前端设计工程师 意向地点湖北武汉 面试时间2023 - 09 - 14 0910 持续时间30 min腾讯会议 面试官1人男 面试流程 自我介绍。从数据流角度介绍一下你的XX项目以及你自己主要负责的方面。你的项目基本都有一些高速通信的内容时序约束怎么做的。除了建立保持时间的分析静态时序分析报告还可以做哪些FPGA设计与ASIC设计时序分析会有哪些区别反问一些问题。 总结感觉问的很浅不知道就是这样还是KPI面且看后续结果如何。 终面主管面 岗位前端设计工程师 意向地点湖北武汉 面试时间2023 - 09 - 22 1130 持续时间30 min线下 面试官2人男 面试流程 自我介绍。介绍一个项目认为有挑战性的难点。问入职前有没有时间提前学习芯片设计验证的知识应该和中科大 “一生一芯” 计划合作在平台上学习设计精简指令集CPU最后通过考核的话入职后的实习培训可考虑缩短或者取消。现场让面试助理打开我的博客查看问博客的原创性积累的时长写博客初衷何在。其他的不太重要 过了终面等待谈薪。 谈薪
谈薪前的交流会 形式腾讯会议 主要信息 1、公司详情 2021年3月18日注册成立的武汉凌久微电子有限公司将以做中国人自己的芯片为己任坚持市场导向充分发挥研究所沉淀的技术积累潜心研制安全、稳定、可靠的自主国产芯片做国产GPU芯片领域的引领者。 2、工作时间: 周一至周五 8: 00-17: 00午休时间为 12: 00-13: 30 (武汉) 周一至周五 8: 30-17: 30午休时间为 12: 00-13: 30 (西安、成都) 3、培养晋升 公司制度流程培训户外拓展 (1-2周)基础技能培训 (不超过35天)一对一导师制培养两年一次竞聘管理岗机会每年一次调薪机会 谈薪 基本月工资11400RMB / 月 绩效6000RMB / 月 共15薪123年终奖总包17400*1526.1W 每月餐补 700RMB 发放至美团账户 公积金缴纳按17400的12%双边共24%五险的缴纳按11400的对应比例。 试用期六个月工资发80%转正后20%的工资会补发。 无末尾淘汰制。一年可申请涨薪一次涨幅10%~20%。无普调。 由于所开薪资与本人预期存在差距在申请之后迎来了第二次谈薪总包29.1Wbase提升至12900RMB / 月绩效提升至6400RMB / 月其他薪资结构和五险一金缴纳比例保持不变。 签约 违约金13000元 次年三月才处理毁约的三方 遂拒签 华为海思
正式批 技术一面 岗位芯片与器件设计工程师数字芯片 意向地点上海 面试时间2023 - 09 - 18 1415 持续时间50min 左右 面试官1人男 面试形式线下面试 面试流程 自我介绍体现在代码编写上的话你觉得FPGA设计与ASIC芯片设计区别在哪里举例说一下了解STA的话你项目中有具体用到时序分析和约束吗结合项目说一下手撕一道代码题关于上下游模块的握手对接模块的缓存深度为1主要端口包括 复盘一道笔试题问验证里面同步怎么做到event、mailbox、semaphore并且问具体是啥意思怎么实现同步看了一道题关于三个 initial 块里面对于同一个信号的赋值问不同仿真时刻信号的值分别是多少类似这种问X在不同时刻的取值。 Vivado仿真结果 主要的注意点 1、所有的 initial 块都是在仿真零时刻同时并行执行的 2、非阻塞赋值的延迟不影响后面阻塞赋值的执行 3、存疑面试官告诉我说最后R变化的时候X也应该变化但是仿真来看没有变化。可能是不同的仿真平台有差别吧此处存疑。 后面应该没问啥了就算问了可能也是不太重要的记不得了。 面试完出来很快就短信通知面试过了等待二面。 正式批 技术二面 岗位芯片与器件设计工程师数字芯片 意向地点上海 面试时间2023 - 09 - 18 1530 持续时间60min 左右 面试官1人男 面试形式线下面试 面试流程 自我介绍问了芯片的低功耗设计因为我简历写了时钟门控、降低翻转率、电源门控等UART串口的速率用的多少简单说下IIC协议问板级这两根通信线有什么硬件结构。上拉电阻到高电平手撕一道代码关于CDC的20MHz和30MHz之间的应用场景是关于CPU中断状态的置位与清零。可以用脉冲展宽然后用同步器打拍处理也可以握手的方式稍许麻烦。题目本身理解了之后不是很难。问AXI总线有哪些通道握手咋实现outstanding反问环节 后面应该没问啥了就算问了可能也是不太重要的记不得了。 面试完出来很快就短信通知面试过了等待主管面。 正式批 主管面kirin部门 岗位芯片与器件设计工程师数字芯片 意向地点上海 面试时间2023 - 09 - 18 1714 持续时间20min 左右 面试官1人女 面试形式线下面试 面试流程 自我介绍挑一个项目说一下系统结构你自己负责那部分的主要工作怎么看待华为的企业文化今年工作找的咋样了包括身边人为啥想来上海反问环节 面试完出来过了一段时间就短信通知面试过了至此华为秋招面试结束。 华为面试小结 线下面试所有的代码都是写在A4纸上这个环节不要太担心主要还是写代码写完以后面试官会让你说思路怎么想的即使现场写的代码有点瑕疵或者欠考虑一些条件都不是很重要毕竟没有给你debug的时间和条件。 所以在交流环节告诉面试官你的理解和想法很关键。 我的这个记录仅作参考因为每个人项目经历不一样简历写得也千差万别所以面试的时候问的内容也是差别很大的加油吧。 后续 12月22日等到了主管的电话沟通了薪资待遇说是已经报批。考虑到以后职业的发展准备毁约新思签海思。 2024-01-29目前还在等待意向书……遥遥无期 2024-01-31收到意向书 2024-02-02签约沟通会议 中新赛克
技术面 岗位前端设计工程师 意向地点江苏南京 面试时间2023 - 09 - 25 1530 持续时间30 min腾讯会议 面试官1人女 面试流程 共享屏幕共享简历内容自我介绍。介绍项目问道信号处理中乘法器的使用是否是专用硬件乘法器。问各信号处理环节数据位宽以及截位处理。另一个项目的AD芯片配置SPI雷达系统可重构特点体现在哪里。问目前RTL代码量有多少。 中新赛克以前是中兴的子公司现在好像被卖了。据说没啥技术加班很严重绩效就看加班时长还会裁应届生。如果想去可得打听清楚再决定。我的话也就面一面看给开多少应该不去的。 Synopsys(新思科技)
面试前沟通 形式电话 内容了解本人籍贯学历专业等情况。了解一些IC设计知识的掌握情况。RTL代码编写、测试验证覆盖率、CDC设计、综合synthesis等等。 技术一面 岗位数字IC前端设计 意向地点湖北武汉 面试时间2023-10-24 16:30~18:20 面试官2人 面试关键point 自我介绍选择一个最熟悉的项目讲一下画一下框图并口述介绍。由于项目用到一些知识关于UART全双工还是半双工自己写RTL代码还是用IP实现RTL代码如何实现的画一下框图。串口指令结构是否有校验如何校验校验的作用关于AD采样与数据传输缓存如何实现吞吐量评估让手写一个固定优先级的仲裁器if-else结构可否替换为case关于复位同步复位优点异步复位优点异步复位同步释放的电路图关于时序分析建立保持时间的概念一个计算最高时钟频率的时序分析题。关于FPGA开发流程介绍一下。关于约束时序约束用过哪些约束命令关于CDC如何实现异步FIFO的地址数据CDC问题空满标志判断。 总结问的很细没准备的话很容易被问住。 1~2周出结果。 后续进展 2天后收到HR电话面试次周一收到offer。 10月31日签约新思科技了。感觉在武汉外企还是很香的WLB弹性工作制无加班。带薪年假18天每年加一天26天封顶。 宇量昇科技
技术一面 岗位FPGA开发工程师 意向地点上海 面试时间2023-12-28 1900~1945 面试官1人 面试关键point 自我介绍问项目个人感觉主要会问一些接口比如IIC UART ADC 以太网。 技术二面 岗位FPGA开发工程师 意向地点上海 面试时间2023-12-28 2030~2100 面试官1人 面试关键point 自我介绍问项目主要问一些静态时序分析、UDP、GTH、serdes问了一个题目32选1需要几个6输入LUT逻辑级数是多少 主管面 岗位FPGA开发工程师 意向地点上海 面试时间2024-01-06 1600~1610 面试官1人 面试关键point 自我介绍现有已签约offer情况年薪多少签了为啥又找毁约容易吗期望薪资简单聊FPGA在公司的应用开发情况 offer 大概审批一周给了offer给的级别是L5好像说和华子15C持平。
