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就在2月21日#xff0c;ARM发布了新一代面向服务器的高性能处理器N3和V3#xff0c;N系列平衡性能和功耗#xff0c;而V系列则注重更高的性能。此次发布的N3#xff0c;单个die最高32核#xff08;并加入到CCS#xff0c;Compute Subsystems#xff0c;包含CoreARM发布了新一代面向服务器的高性能处理器N3和V3N系列平衡性能和功耗而V系列则注重更高的性能。此次发布的N3单个die最高32核并加入到CCSCompute Subsystems包含CoreSystem Ip等以CCS来讨论每瓦性能比上一代提升20%-50%。而Neoverse V3单个die最高64核加入CCSARM似乎更强调其AI相关的分析能力并于Neoverse V2 相比Neoverse V3 在机器学习方面提供了96%的性能提升在RDBMS上提供了16%的性能提升在加密货币方面提供了9%的性能提升在整数工作负载方面提供了12% 的性能提升。与此同时相关的系统IP同时发布例如新一代的CMN S3这将取代前一代的CMN700但没有更多的信息。 V3微架构的改变
Neoverse™ V3处理器应用 Arm®v9.2-A架构Core接口使用DSU-120Core总体性能提升没有官方数据部分分析认为相比较前代提升大约在10~20%。
MMU MMU左为V3右为V2
MMU仍然延续经典的2级TLB结构更细节的微架构设计手册没有过多的描述Translation Cache聚合预取等传统技术依然存在对于L2 TLB3代微架构没有明显的改变。最大的改变是 L1 TLB其中ITLB的entry从V2的48entry升级到V3的128entry而DTLB 从48entry升级为96entry。最具特点的是ITLB的巨大升级可能是为了应对AI场景下指令集地址变化更频繁。这也是为什么ARM对V3更强调AI场景的分析。
L1 Cache ICache上为V3下为V2
ICache的改变主要在V3抛弃了Macro-Operation Cache手册没提应该是放弃了这里亦安分析可能是对于精简指令集这种做法性价比不高或者设计确实没有达到理想的状态再者ARM本身非常关注功耗所以在V3处理器版本抛弃了这种微架构。手机端A77A78X1X2X3均具有MOPCacheX4放弃该微架构。
DCache在参数上描述无差异。
L2 Cache L2 cache,上V3下V2
L2从官方描述上看从原来的V21-2MB升级V32-3MB其它参数没有明显变化详细的微架构尚不清楚。
总结
由于V3/N3刚刚发布其它例如预测器乱序等模块的微架构尚不清晰等待公布更多信息再聊除去按照惯例的性能提升描述比较值得关注的是ARM对处理器涉及AI分析的强调由此可以知道近几年AI发展对整个芯片行业的巨大冲击似乎只有往AI上靠才会获得市场的青睐这一场AI争夺战已经进入白热化芯片行业本身就处在中心。
