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在FPGA设计中Xilinx Vivado软件是一款功能强大的设计工具它不仅支持硬件描述语言HDL的开发还提供了丰富的图形化设计界面方便用户进行硬件设计、调试和测试。这里我们将详细介绍如何使用Vivado软件点亮ZYNQ-7010开发板上的LED灯涵盖从工程创建到代码实现的全过程。 一. 环境准备
在开始之前请确保您已安装以下软件和工具。请看 Xilinx Vivado Design SuiteZYNQ-7010开发板USB JTAG调试器如Xilinx Platform Cable USB 二. 创建工程
创建 Vivado 工程请看
1. 打开和创建 打开Vivado点击“Create New Project”点击下一步。 2. 名称和位置 在“Project Name”框中输入项目名称选择一个合适的存储位置并点击“Next”。 3. 选择和同意 在“Project Type”中选择“RTL Project”勾选“Do not specify sources at this time”然后点击“Next”。 这里众多选项分别代表不同意思请看 新项目 项目类型 指定要创建的项目类型。 RTL项目 您将能够添加源文件、在IP集成器中创建模块设计、生成IP、运行RTL分析、综合、实现、设计规划和分析。 ☐ 此时不指定源文件 后综合项目 您将能够添加源文件、查看设备资源、运行设计分析、规划和实现。 ☐ 此时不指定源文件 I/O规划项目 不指定设计源文件。您将能够查看部件/封装资源。 导入项目 从Synplify、XST或ISE项目文件创建Vivado项目。 示例项目 从预定义的模板创建一个新的Vivado项目。 这里我们选择第一项添加项目源文件。
4. 选择和型号 在“Default Part”页面中选择您的ZYNQ-7010开发板的型号如Zynq-7000系列选择Package 引脚类型然后选择Speed 速度等级再选择Part 部件类型最后点击“Next”。 这里也有很多选项分别代表不同意思请看 新项目 默认部件 为您的项目选择一个默认的Xilinx部件或板。 部件 | 板卡 重置所有过滤器 类别全部 封装clg400 温度剩余所有 家族Zynq-7000 速度-2 静态功耗剩余所有 搜索 根据自己开发板的型号对号入座选择对应选项。 5. 点击和完成 最后点击“Finish”完成项目创建。 正在创建 完成创建后来到主页。 三. 添加文件
添加源文件请看
1. 添加文件 在“Project Manager”中右键单击“Sources”文件夹选择“Add Sources”或者点击加号➕图标还可以鼠标右击都可以添加源文件。 2. 选择同意 选择“Add or create design sources”添加或创建设计源文件点击“Next”。 分别表示 添加源文件 添加源文件 此向导引导您完成为项目添加和创建源文件的过程。 添加或创建约束条件添加或创建设计源文件添加或创建仿真源文件 这里我们选择第二项添加或创建设计源文件。 3. 创建源文件 点击“Create File”选择File type语言类型 和 File name文件名称然后点击“OK”后点击“Finish”完成创建。 这里创建的是项目里面的文件下面图片头部显示的是我们创建的项目名称和位置注意区分。 然后这里还会弹出模块弹框直接输入模块名称点击 OK 点击 Yes 完成创建。 双击LED.v打开源文件可以看到项目和源文件创建成功。 四. 编写代码
编写Verilog代码以下是点亮LED灯的Verilog代码示例。请看
// led_control.v
module led_control (input wire clk, // 时钟信号output reg [3:0] led // 4个LED灯的控制信号
);// 时钟分频器产生一个较慢的LED闪烁频率reg [23:0] counter; // 计数器用于时钟分频always (posedge clk) begincounter counter 1; // 计数器自增if (counter 24d12499999) begin // 根据需要调整这个值led ~led; // 取反LED状态counter 0; // 重置计数器endendendmodule代码说明 输入端口clk接收系统时钟信号。输出端口led控制4个LED灯的状态。计数器counter用于实现时钟分频生成LED闪烁效果。always块在每个时钟上升沿更新计数器并在计数器达到设定值时切换LED状态。 五. 添加约束
添加约束文件为确保 Vivado 正确地连接开发板上的引脚我们需要添加一个约束文件XDC文件。请看 右键单击“Constraints”文件夹选择“Add Sources”。 选择“Add or create constraints”点击“Next”。 创建一个名为constraints.xdc的约束文件然后点击“Finish”。 在constraints.xdc中添加以下内容确保将引脚与LED连接正确 # LED引脚连接
set_property PACKAGE_PIN A2 [get_ports led[0]] # LED0
set_property PACKAGE_PIN A3 [get_ports led[1]] # LED1
set_property PACKAGE_PIN A4 [get_ports led[2]] # LED2
set_property PACKAGE_PIN A5 [get_ports led[3]] # LED3
set_property IOSTANDARD LVCMOS33 [get_ports {led[0] led[1] led[2] led[3]}]引脚配置说明 PACKAGE_PIN指定FPGA封装的引脚号。IOSTANDARD指定引脚的输入输出标准这里使用LVCMOS33。 六. 综合实现
综合与实现请看 在Vivado工具栏上点击“Run Synthesis”以综合设计。 等待综合完成后点击“Run Implementation”进行实现。 实现完成后点击“Generate Bitstream”生成比特流文件.bit。 七. 编程开发
编程开发板请看 将ZYNQ-7010开发板连接到计算机打开Vivado的“Open Hardware Manager”。 点击“Open Target”选择“Auto Connect”。 在“Hardware Manager”中右键单击“Program Device”选择刚生成的比特流文件点击“Program”。 等待编程完成您将看到LED灯开始闪烁。 八. 本篇小结 通过以上步骤我们成功使用Xilinx Vivado软件创建了一个FPGA工程编写Verilog代码并点亮了ZYNQ-7010开发板上的LED灯。在实际开发中我们可以根据需要修改LED的闪烁频率和控制逻辑为其他硬件设计打下基础。希望能帮助到你 创作不易感觉有用就一键三连感谢(●◡●)
